Fast, minimal decoding complexity, systematic (13, 8) single-error-correcting codes for on-chip DRAM applications
A fast, minimal decoding complexity, binary systematic single-error-correcting code with one extra parity-bit penalty is presented. It is shown that the new code can be encoded and decoded in combinatorial circuits with minimal decoding complexity. Fast codes are particularly suitable for a 64 bit w...
Uloženo v:
| Vydáno v: | Electronics letters Ročník 37; číslo 7; s. 438 - 440 |
|---|---|
| Hlavní autor: | |
| Médium: | Journal Article |
| Jazyk: | angličtina |
| Vydáno: |
29.03.2001
|
| ISSN: | 0013-5194 |
| On-line přístup: | Získat plný text |
| Tagy: |
Přidat tag
Žádné tagy, Buďte první, kdo vytvoří štítek k tomuto záznamu!
|
Buďte první, kdo okomentuje tento záznam!