An Efficient I/O Architecture for RAM-Based Content-Addressable Memory on FPGA

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Bibliographische Detailangaben
Veröffentlicht in:	IEEE Transactions on Circuits and Systems II: Express Briefs Jg. 66; S. 472 - 476
Hauptverfasser:	Xuan-Thuan Nguyen, Trong-Thuc Hoang, Hong-Thu Nguyen, Katsumi Inoue, Cong-Kha Pham
Format:	Journal Article
Sprache:	Japanisch
Veröffentlicht:	Institute of Electrical and Electronics Engineers (IEEE) 01.03.2019
Schlagworte:	Computer Science - Hardware Architecture FOS: Computer and information sciences Hardware Architecture (cs.AR)
ISSN:	1549-7747, 1558-3791
Online-Zugang:	Volltext
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Beschreibung
ISSN:	1549-7747 1558-3791
DOI:	10.48550/arxiv.1804.02330